Formal Semantics and Proof Techniques for Optimizing VHDL Models

Sprache: Englisch

Verlag: Springer, 1998

0792383753 / 9780792383758

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Druck auf Anfrage Neuware - Printed after ordering - Formal Semantics and Proof Techniques for Optimizing VHDL Models presents a formal model of VHDL that clearly specifies both the static and dynamic semantics of VHDL. It provides a mathematical framework for representing VHDL constructs and shows how those constructs can be formally manipulated to reason about VHDL. The dynamic semantics is presented as a description of what the simulation of VHDL means. In particular it specifies what values the signals of a VHDL description will take if the description were to be executed. An advantage of the approach is that the semantic model can be used to validate different simulation algorithms. The book also presents an embedding of the dynamic semantics in a proof checker which is then used to prove equivalences of classes of VHDL descriptions. Formal Semantics and Proof Techniques for Optimizing VHDL Models is written for hardware designers who are interested in the formal semantics of VHDL.…

Bestandsnummer des Verkäufers 9780792383758

Titel
Formal Semantics and Proof Techniques for Optimizing VHDL Models
Autor
Philip A. Wilsey
Verlag
Springer
Erscheinungsjahr
1998
Zustand
Neu
Einband
Buch
Sprache
Englisch
ISBN-10
0792383753
ISBN-13
9780792383758
Artikelgewicht
395 Gramm
Abmessungen
241x160x15 mm

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