High Speed Digital Design: Design of High Speed Interconnects and Signaling
Sprache: Englisch
Verlag: Morgan Kaufmann Pub, 2015
- Softcover
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- Titel
- High Speed Digital Design: Design of High Speed Interconnects and Signaling
- Autor
- Zhang, Hanqiao/ Krooswyk, Steven/ Ou, Jeff
- Verlag
- Morgan Kaufmann Pub
- Erscheinungsjahr
- 2015
- Zustand
- Brand New
- Einband
- Paperback
- Sprache
- Englisch
- ISBN-10
- 0124186637
- ISBN-13
- 9780124186637
- Artikelgewicht
- 0,55 Kilogramm
High Speed Digital Design discusses the major factors to consider in designing a high speed digital system and how design concepts affect the functionality of the system as a whole. It will help you understand why signals act so differently on a high speed digital system, identify the various problems that may occur in the design, and research solutions to minimize their impact and address their root causes. The authors offer a strong foundation that will help you get high speed digital system designs right the first time.
Taking a systems design approach, High Speed Digital Design offers a progression from fundamental to advanced concepts, starting with transmission line theory, covering core concepts as well as recent developments. It then covers the challenges of signal and power integrity, offers guidelines for channel modeling, and optimizing link circuits. Tying together concepts presented throughout the book, the authors present Intel processors and chipsets as real-world design examples.
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Über die Autorin bzw. den Autor
Steve Krooswyk has been at Intel since 2003 when we joined as a signal integrity engineer for EPSD server development. In 2009, Steve transitioned into the signal integrity lead for PCI Express in Intel’s Enterprise Platform Technology Division (EPTD). In addition to server products, his experience includes involvement in the PCI Express 3.0 and 4.0 specifications. He holds a B.S. and M.S. in electrical engineering from the University of South Carolina.
Jeffrey Ou joined Intel in 1999 as an analog design engineer in CMOS RF transceiver design. In 2006, Jeffrey transitioned to Xeon processor product design team in Server Development Group (SDG) developing a serial I/O module configurable for PCI Express and Quick Path Interface (QPI). Since then Jeffrey has been involved in several generations of Xeon products from design to post silicon validation. In 2012, Jeffrey was recognized as a tech lead in SDG, and continued to develop the cutting-edge high speed serial I/O modules for server products. Jeffrey holds a PhD degree in EECS from UC Berkeley and is a member of IEEE.
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