This work is aimed towards the implementation of a fault-tolerant memory system with the help of supporting circuits. This work demonstrates an improvement on the reliability of a semiconductor memory system using Error control codes (ECC)and Low Density Parity Check (LDPC) Codes as a part of protecting support logic. It is observed that the error correcting codes with higher hamming distances can detect more errors i.e. as higher the hamming distance higher the error control capability.
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Asst.Prof.Poluboyina Lavanya and Assoc.Prof.Gobinda Prasad Acharya are upgrowing research scholars of JNTUK and JNTUH in the areas of wireless networks and VLSI testing respectively. N S Murti Sarma together with above are faculty of Sreenidhi Institute of Science and Technology. All the authors of the book are with significant credits of research.
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Paperback. Zustand: Brand New. 128 pages. 8.66x5.91x0.29 inches. In Stock. Artikel-Nr. 3330044195
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Taschenbuch. Zustand: Neu. Realization of Memory Fault Tolerance using Error Correcting Codes | N. S. Murti Sarma (u. a.) | Taschenbuch | 128 S. | Englisch | 2017 | LAP LAMBERT Academic Publishing | EAN 9783330044197 | Verantwortliche Person für die EU: preigu GmbH & Co. KG, Lengericher Landstr. 19, 49078 Osnabrück, mail[at]preigu[dot]de | Anbieter: preigu. Artikel-Nr. 108505592
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